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BVP-9500WS/9500WSP MM
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16 15 14 13 12 11 10 9 8 7 6 5 4 3 2 1
EMBEDDED PROGRAMMABLE LOGIC DEVICE
—BOTTOM VIEW—
INDICATES
LOCATION OF
BALL A1
(TOP SIDE)
EPF10K50SFC256-3 (ALTERA)
PIN
NO.
I/O
SIGNAL
PIN
NO.
I/O
SIGNAL
PIN
NO.
I/O
SIGNAL
PIN
NO.
I/O
SIGNAL
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I/O
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CLK
I/O
I/O
I/O
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CS
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I/O
I/O
I/O
IN
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I/O
I/O
I/O
WS
/I/O
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I/O
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DATA3/I/O
I/O
I/O
I/O
I/O
I/O
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I/O
I/O
I/O
I/O
RS
/I/O
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I/O
I/O
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I/O
I/O
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GND
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GND
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I/O
I/O
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CC
GND
V
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GND
GND
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I/O
RDY/
BSY
/I/O
I/O
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I/O
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GND
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GND
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GCLK1/CLK
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CONFIG
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I/O
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LOCK/I/O
I/O
I/O
TMS
I/O
MSEL1
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IN
I/O
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I/O
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TRST
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I/O
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STATUS
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I/O
I/O
I/O
INPUTS
CE
CLK
CLKUSR
CONFIG
CS,
CS
DCLK, GCLK1
DEV CLR
DEV OE
IN
LOCK
MSEL0, MSEL1
RS
TCK
TDI
TMS
WS
OUTPUTS
CEO
CONF DONE
INIT DONE
RDY/
BSY
STATUS
TDO
TRST
INPUTS/OUTPUTS
DATA0 - DATA7
I/O
: CHIP ENABLE
: DEDICATED CLOCK
: OPTIONAL USER-SUPPLIED CLOCK
: CONFIGURATION CONTROL
: CHIP SELECT
: CLOCK
: CLEAR ON DEVICE
: OUTPUT ENABLE ON DEVICE
: DEDICATED INPUT
: CLOCK LOCK
: 2-BIT CONFIGURATION
: READ STROBE
: TEST CLOCK
: TEST DATA
: TEST MODE SELECT
: WRITE STROBE
: CHIP ENABLE
: STATUS
: STATUS PIN
: READY
: STATUS
: TEST DATA
: TEST RESET
: DATA
: I/O
IC
Summary of Contents for BVP-9500WS
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